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wilson_chen/HDLGen

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HDLGen是一个HDL/RTL生成工具，支持在Verilog里内嵌Perl或Python script来帮助快速、高效地生成期望的设计，支持Perl或者Python的所有数据结构和语法，有若干内嵌函数来提高效率，也支持扩展API，支持自动Instance、自动信号生成、IPXACT、JSON、XML、模板等输入来减少手动工作、提高开发效率、降低出错几率，大大提高IP开发和SOC集成的效率
hdl
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SOC
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智能硬件
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9132807 middle class free heart 1646744556

中流自在心/soc_demo

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2195160 xuxiaokang 1667981588

徐晓康/ZYNQ7000的ARM开发

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2年多前
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